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DL07-DGC40++  数字电路创新设计开发系统

DL07-DGC40++ 数字电路创新设计开发系统

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产品报价:
面议
公司名称:
北京北信创展自动化技术...
所在地区:
北京市
产品型号:
DL07-DGC40++
更新时间:
2016-05-05 16:03
厂商性质:
生产商

联系人:屈经理 15300162764

(联系我时,请说明是在中国仪表网上看到,谢谢!)

模块化系统的结构示意图。由于以上所示二教材中大量的实验和设计项目涉及许多不同类型的,可自由增减的扩展模块,主系统平台上有许多标准接口。

数字电路创新设计开发系统 详细信息

数字电路创新设计开发系统

    型号:DL07-DGC40++ 

 

 

与《实用数字电子技术基础》教材配套的实验开发与创新设计的设备是:

 

一、模块化数字电路实验与创新设计综合实验系统

    模块化系统的结构示意图。由于以上所示二教材中大量的实验和设计项目涉及许多不同类型的,可自由增减的扩展模块,主系统平台上有许多标准接口。以其为核心,对于不同的实验设计项目,可接插上对应的接口模块。如VGA/PS2模块、宽位数据输入输出模块、液晶模块、各类存储器模块、电机模块、各类键盘模块、数码管/发光管显示模块等等;这些模块可以是现成的,也可以根据主系统平台的标准接口和创新要求由教师或学生自行开发。

   

显然类似DL07_DGC的模块自由组合型综合实验系统容易成为高校目前十分流行的实践平台,其基本特点是:

 

◆ 由于系统的各实验功能模块可自由组合、增减,故不仅可实现的实验项目多,类型广,更重要的是很容易实现形式多样的创新设计;

◆ 由于各类实验模块功能集中,结构经典,接口灵活,对于任何一项具体实验设计都能给学生独立系统设计的体验,甚至可以脱离系统平台;

◆ 面对不同的专业特点,不同的实践要求和不同的教学对象,教师,甚至学生自己可以动手为此平台开发增加新的实验和创新设计模块;

◆ 由于系统上的各接口,以及插件模块的接口都是统一标准的,提供了所有接口电路图,因此此系统可以通过增加相应的模块而随时升级;

特别要强调的是,KX_DGC55系统在除了适用于此二教材中涉及的所有数字电路和数字系统实验和创新实践外,还能很专业地包涵诸如EDA技术实验、硬件描述语言应用实验、单片机技术实验、SOPC开发、各类IP的应用、SOC片上系统设计、计算机组成实验和微机原理与接口技术实验等。整个课程体系的实验和设计都可以在此实验系统上完成。

 

DL07-DGC40+配置如下:

 

一、基本平台

 

编号:A 主系统

☆此平台最多可同时插12 块模块板。

☆ DL07_USB-Blaster2型双功能编程器:(1)USB-Blaster编程下载功能(支持AS、PS、JTAG模式):1、对FPGA/CPLD进行配置或编程;2、对配置器件EPCSx编程;3、访问和编辑FPGA内部RAM;4、调试Nios2,完成SOPC设计;5、支持SignalTapII 嵌入式逻辑分析仪。

(2)USB到UART串行通信转换:1、通过USB与FPGA串行通信,实现PC与FPGA的串行通信,且无需RS232电平转换;2、通过USB与单片机的串行通信,实现PC与通用单片机的UART串行通信;3、通过USB

对STC等系列单片机进行直接编程开发,无需电平转换。

☆ ByteBlasterMV编程器一个(可对isp单片机编程)。

☆ 5功能智能逻辑笔:可显示高电平、低电平、中电平、高阻态、脉冲信号。注意有“高阻态”测试功能。

☆ 独立的标准时钟频率20个。20MHZ-0.5HZ。

☆ 电源有自动保护的+5V,+12V、-12V、、+3.3V、2.5V+、1.2V。

☆ 8个LED放光二级管,8个乒乓开关,扬声器。

☆ DDS信号输出口及幅度、偏移调谐。

 

编号:B2、FPGA模块二

 Cyclone III FPGA EP3C40Q240,约300万门、4锁相环,120万RAM bit,4万LCs,16M Flash EPCS16,超宽超高锁相环输出频率1300MHz至2kHz,22对LVDS差分通道,252个9X9bit数字乘法器等,板上还有3032 CPLD、16M EPCS16 Flash、32M SDRAM。提供多种IP核:32位NiosII核、20MHz有源晶振等。

FPGA板包含 8051/52 IP核。提供商业级全兼容MCS-51单片机IP核。利用此核,实验者可以实现传统单片机实验系统无法达到的SOC(片上系统)设计。即将单片机CPU、RAM、ROM以及其它各类接口电路模块设计在同一片FPGA中。此类技术对于对于面向高新技术企业的就业十分必要。 8088、8086 CPU IP核。 8255A IP核模块;8255A IP核(I/O接口);8253/8254 IP核(定时器);8250 IP核(UART串行通信);8237 IP核(DMA控制器);8259 IP核(可编程中断控制器),以及基于FPGA的RAM/ROM核、锁相环核等。这些IP核与8088CPU核相结合就能在单片FPGA中构成一个微机系统,从而学习到实用的SOC设计工程技术。FPGA中的8088核与MCS-31单片机核及其中的各种模块和核都能与以下各模块结合,实现不同类型的实验开发。

编号:C5、可重构型DDS全数字函数信号发生器模块

全数字型DDS函数信号发生器模块,含FPGA、单片机、超高速DAC、高速运放等。既可用作全数字型DDS函数信号发生器,同时也可作为EDA/DSP系统及专业级DDS函数信号发生器设计开发平台。作为DDS函数发生器的功能主要包括:等精度频率计,全程扫频信号源(扫速、步进频宽、扫描方式等可数控),移相信号发生,里萨如图信号发生,方波/三角波/锯齿波和任意波形发生器,以及AM、PM、FM、FSK、ASK、FPK等各类调制信号发生器。

 

编号:C84X4+8个单脉冲综合键盘模块
编号:C10、24位输出显示HEX模块
编号:C13、点阵式128X64液晶显示模块

编号:C14、字符式20X4液晶显示模块

编号:C21、SD+PS2+RS232+VGA显示接口模块

编号:C23、电机接口模块

编号:C25、语音处理+4动态扫描模块

编号:C32、交通灯模块

编号:D35传统数字电路模块,提供部分74系列实验器件及接口

○ 基本软件:1Quartus II 9.0/11.0;2ModelSim;3Synplify;4IDE;58051单片机IP核;68088/8086 CPU IP核;78088/8086微机系统接口模块IP核:8253核、8237核、8259核、8255IP核和8250等IP核;8Nios II

 

基于EDA技术的实验:部分)

 

13-8译码器构成1位全加器

2、基于CASE语句的3-8译码器构成1位全加器

3、1位全加器设计

4、16进制数至7段LED显示译码器

5、抖动消除电路设计

6、基于74161的12进制计数器

7、基于广义译码器的计数器

8、基于广义译码器的12进制计数器

9、基于一般模型的异步预置型12进制计数器

10、基于一般模型的抗干扰型10进制计数器

11、基于一般模型的可预置型计数器

12、基于LPM计数器模块的8位可预置型计数器

13、步进电机双向控制电路设计

14、步进电机控制

15、直流电机控制

16、简易波形发生器设计

17、基于DDS的信号发生器

18、状态机控制ADC采样

19、6位普通频率计设计

20、模型数字电子琴设计

21、乐曲自动演奏电路设计

22、乒乓球游戏电路设计

24、VGA彩条信号控制设计

25、VGA图像显示控制电路设计

26、等精度频率计设计       

27、 串行通信与频谱分析

 

提供基于数字电路创新实验:

 

1、PS2键盘控制电子琴;

2、VGA显示游戏;

3、DDS移相信号发生器;

4、PS2控制俄罗斯方块游戏;

5、彩色液晶点灯游戏实验;

6、LCD显示超级玛丽游戏等。

7、点阵液晶游戏实验

等等


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