临沂市 MOORE 39SDM024DCCAN *供应 返回列表页

MOORE 39SDM024DCCAN 在发送IPROG指令之前，需要对ICAP核进行预配置。重载控制模块在收到触发信号后，*个时钟周期将ICAP核的WRITE信号和CE信号置高，第二个周期将WRITE信号置底，CE信号置高，第三个周期将WRITE信号置底，CE信号也置底。接着在下面的8个时钟周期里，将指令队列中的控制命令逐个发出。状态机指令流程如图3所示。

　　MOORE 39SDM024DCCAN 在状态机发送IPROG指令的过程中，为了保证ICAP核接收到正确的指令，每一个发送出去的命令和数据必须遵循SelectMAP数据顺序。SelectMAP数据顺序是将每个指令都按字节划分，划分后每个字节的数据都按比特位翻转。如果为“X32”模式，则划分为4个字节，每个字节进行位翻转。图4以“X16”为例说明Se-lectMAP数据顺序。

　　当状态机从用户程序接收到一个触发条件后，会发送一系列如图3所示的IPROG命令。Verilog编码实现状态机的过程中，必须按照图3给出的指令顺序发送这些IPROG命令，否则无法正确的与ICAP核通信。同时这些指令都具有自己特殊的定义而且必须服从Select-MAP数据顺序，否则无法通信。IPROG指令的具体定义及说明如表1所示。

　　在上述配置指令过程中，第五步Warm Boot StartAddress Register（WBSTAR）了满足触发条件的比特流在SPI FLASH中的起始地址，WBSTAR被赋值的地址必须和即将配置的bit流在SPI FLASH中的物理位置相同，否则FPGA就无法从外部读取bit流。WBSTAR被赋值的数值都是提前根据程序的要求计算好的。计算WBSTAR值的时候需要了解WBSTAR寄存器每一位的具体含义，如图5所示。

MOORE 39SDM024DCCAN 寄存器共31位，高三位是保留位，RS［1：0］

　　两位了可以多重配置的bit流的个数。RS_TS_B是RS［1：0］的使能信号：0表示Disabled，1表示Enabled.

　　MOORE 39SDM024DCCAN 表示要回读的比特流在外部配置存储器的起始地址。状态机在对WBSTAR进行赋值时，要根据自己选择的bit流个数以及对应各个bit流在外部配置存储器贮存的地址自行计算WBSTAR地址。这里以4个bit流为例说明WBSTAR地址的计算方法，如表2所示。状态机使用的地址是服从SelectMAP数据顺序的地址。FPGA配置逻辑在收到IPROG指令后，开始执行内部复位操作（JATG管角和重载控制部分不进行复位操作），擦除板卡上原有的程序，从FLASH芯片中WBSTAR所指向的起始地址开始读取新配置文件完成FPGA的重配置。

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