KSD1-64 KUKA 江苏省* 返回列表页

KSD1-64图像处理系统结构 本系统采用TI公司C6000系列DSP中的TMS320C6211作为系统的CPU。图像数据通过视频头输入模拟图像信号，这些信号经过视频解码芯片进行A/D转换为数字信号，经FIFO输入DSP进行图像的增强、分割、特征提取和数据压缩等，然后输出信号经PCI解码芯片转换为符合PCI总线规范的标准信号，通过PCI总线接口传到上位机。 KSD1-64本系统设计目的是用于智能楼宇的管理，主要实现对楼宇一些重要参数的实时检测功能等。当然可以用于其他的监控系统，其硬件系统基本*，不同的在于软件功能的区别。系统结构图如图1。

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从图1可以看出，整个系统可分为3个模块: KSD1-64图像处理模块，视频解码模块，PCI总线模块。下面分别介绍这3个模块的实现过程和功能。 2.1 DSP图像处理模块 本系统选用TI公司的C6000系列DSP之中的TMS320C611作为本系统的CPU。C6000是TI公司发布的面向视频处理领域的新款高速数字处理芯片，适用于移动通信基站、图像监控、雷达系统等需要高速度和高度智能化的应用领域。存储空间选用现代公司的2片HY57V651620B作为运行过程中的存储器（SDRAM）和AMD公司的AM29LV800B 作为启动时候需加载程序和参数的存储器（FLASH）。其结构如图2所示。图中的HPI（Host Port Interface）为主机口;EMIF（External Memory Interface）为外部存储器接口，兼容同步/异步方式。

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（1） KSD1-64处理器特性及完成功能 TMS320C6211处理器由3个主要部分组成:CPU内核、外设和存储器。它的高速性能主要体现在如下几个方面:① TMS320C6211的存储空间zui大扩展可以达到512MB，这*可以满足各种图像处理系统所需的内存空间，而且其zui高时钟可达167MHz，峰值性能可达1600MIPS（百万条指令/秒）、2400MOPS（百万次操作/秒）。

② 并行处理结构。KSD1-64芯片内有8个并行处理单元，分为相同的两组，并行结构突破传统设计使得芯片具有很高的性能。

③ 芯片体系采用VelociTI结构。VelociTI是一种高性能的甚长指令字（VLIW）结构，单指令字字长为32bit，8个指令组成一个指令包，总字长为256bit，即每秒钟可以执行8条指令，同时芯片内部设置了专门的指令分配模块，可以将每个256bits的指令包同时分配到8个处理单元，并由8个单元同时执行。

④ 采用流水线操作实现高速度、高效率。KSD1-64只有在流水线充分发挥作用的情况下，才能达到zui高的MIPS。C6211的流水线分为3个阶段:指令读入、解码和执行，总共11级。

KSD1-64完成的功能主要是对从FIFO读入的数据进行处理，包括依照程序进行识别、特征提取以参数检测等。当视频头采集速度为每秒25帧图像时，它留给DSP处理的时间zui多为每帧40ms，如果考虑系统中一定的延时以及处理后图像的存储时间，那么DSP处理一幅图像时间不能超过30ms，按照C6211的处理速度，在30ms内可以处理36M条指令。

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Applied Materials 0020-98649

Applied Materials Prom Board 670774

Applied Materials AMAT Chemraz O-Ring, 3700-02414

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Applied Materials AMAT Kalrez O-Ring, 3700-03547

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