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JAMSC-B1060硬件设计 

JAMSC-B1060硬件设计设计包括了MVB控制器的FPGA设计和MVB总线系统的板级设计，其中关键的MVB控制器的设计如图5 [align=center] 

图5：JAMSC-B1060控制器的框图[/align] 如图所示，MVB控制器包含以下功能模块：

●编码器：产生曼彻斯特编码，传送数据帧

●发送缓冲区：作为要发送的数据和CRC检测值的缓冲区

●译码器：接收、曼彻斯特译码，数据提取、数据错误检测

●接收缓冲区：作为接收端数据和CRC结果的缓冲区

●报文分析单元：检测主帧和从帧超时，帧误检测、错误状态报告

●状态控制寄存器：MVBC配置

●主控单元：支持MVBC作为主设备或者从设备工作，支持队列消息传送

●设备地址读取和储存单元：硬件定义的设备地址可以被不同的值覆盖

●地址逻辑：把CPU对MVBC内部寄存器进行访问的输入地址进行解析；产生MVBC访问TM的输出地址

●总线复用、转换单元：处理MVBC内部的数据传送

●中断逻辑：支持16种中断源；

●通用定时器：两个定时输出信号，可提供给系统同步使用

●时钟产生电路:产生所有MVBC工作的时钟和计数器 

2、JAMSC-B1060软件设计 由于在MVB系统中，过程数据，消息数据，监视数据是三种不同的通讯机制，因此，MVB系统软件的模块设计如图6。 [align=center] 

图6：JAMSC-B1060系统软件模块[/align] 

四、JAMSC-B1060软硬件的联调和集成 下面，以一个简单的例子来说明MVB系统的软硬件的集成和验证。 过程数据在MVB系统中是周期性发送的数据，其在本系统中的通讯机制如下：对于发送方，用户应用模块将一个端口的过程变量发送给过程数据处理模块，过程数据处理模块按照逻辑端口的设置定时通过链路层接口模块更新Traffic Memory当中的相应逻辑端口的数据，此时发送方软件的任务完成。发送方的MVBC硬件接收总线管理器BA定时发出的主帧，通过译码器解码得到相应的逻辑端口的值，通过查询Traffic Memory相关的逻辑端口发送设置后将MVBC自动设置为发送状态，将逻辑端口的数据作为过程数据从帧通过编码器发出，如图7所示： [align=center] 图7：过程数据通讯示例[/align] 对于接收方，其接收过程与发送方相逆，接收方的MVBC硬件接收总线管理器BA定时发出的主帧，通过译码器解码得到相应的逻辑端口的值，通过查询Traffic Memory相关的逻辑端口接收设置后将MVBC自动设置为接收状态将，在收到发送方发出的从帧后更新相应逻辑端口在Traffic Memory的数据并发出中断信号从而完成硬件的接收过程。接收方的软件可以用中断或定时查询的方式通过过程数据处理模块得到更新后的逻辑端口的过程数据

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10 AINES ALLIGATOR 6P-CL CLIPS LEADS DFH0500 W/PENETRATOR PIN

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